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ITED49-8	pdf	214 KB	2,761

論文情報

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アクセス権	open access
URI	https://hdl.handle.net/2115/5577
タイトル	A three-valued D-flip-flop and shift register using multiple-junction surface tunnel transistors
著者	e-Rad_Researcher 20344476 著者名 Uemura, T. 植村, 哲也
	著者名 Baba, T.
言語	英語
発行日	2002-08
出版者	IEEE
収録物名	IEEE Transactions on Electron Devices
巻(号)	49(8)
ページ	1336-1340
抄録	A three-valued D-flip-flop (D-FF) circuit and a two-stage shift register built from InGaAs-based multiple-junction surface tunnel transistors (MJSTT) and Si-based metal-oxide-semiconductor field effect transistors (MOSFET) have been demonstrated. Due to the combination of the MJSTTs latching function and the MOSFETs switching function, the number of devices required for the D-FF circuit was greatly reduced to three from the thirty required for the FET-only circuit.
資源タイプ	学術雑誌論文
出版タイプ	Version of Record
権利情報	Copyright © 2002 American Institute of Physics
PISSN	0021-9606
関連情報	URI http://www.aip.org/
関連情報 (isIdenticalTo)	出版社版DOI https://doi.org/10.1109/TED.2002.801431

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