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A three-valued D-flip-flop and shift register using multiple-junction surface tunnel transistors

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タイトル: A three-valued D-flip-flop and shift register using multiple-junction surface tunnel transistors
著者: Uemura, T 著作を一覧する
Baba, T 著作を一覧する
発行日: 2002年 8月
出版者: IEEE
誌名: IEEE Transactions on Electron Devices
巻: 49
号: 8
開始ページ: 1336
終了ページ: 1340
出版社 DOI: 10.1109/TED.2002.801431
抄録: A three-valued D-flip-flop (D-FF) circuit and a two-stage shift register built from InGaAs-based multiple-junction surface tunnel transistors (MJSTT) and Si-based metal-oxide-semiconductor field effect transistors (MOSFET) have been demonstrated. Due to the combination of the MJSTTs latching function and the MOSFETs switching function, the number of devices required for the D-FF circuit was greatly reduced to three from the thirty required for the FET-only circuit.
Rights: Copyright © 2002 American Institute of Physics
Relation (URI): http://www.aip.org/
資料タイプ: article
URI: http://hdl.handle.net/2115/5577
出現コレクション:雑誌発表論文等 (Peer-reviewed Journal Articles, etc)

提供者: 植村 哲也

 

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